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Stelle
Techniker (m/w/d) Analytische QA/QC
SGS
💰 Gehalt: keine Angabe
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· Senior
Senior Manager Process Engineering IMP/WET (w/m/div.)
Bosch
💰 Gehalt: keine Angabe
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· Intern
Werkstudent - Engineering Support für R&D Labore (w/m/div)
Infineon
💰 Gehalt: keine Angabe
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· Senior
Senior Equipment Engineer PVD (m/w/div.)
Bosch
💰 Gehalt: keine Angabe
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Data Analyst / Machine Learning Engineer - Fertigungs- & Fügetechnik (all genders)
Fraunhofer
AI/MLData Science
+1
💰 Gehalt: keine Angabe
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Entwickler/in KI & Machine Learning
Fraunhofer
AI/MLCppLlm
💰 Gehalt: keine Angabe
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Gruppenleitung im Bereich Data Communication & Computing (all genders)
Fraunhofer
Verilog
💰 Gehalt: keine Angabe
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Bereichsleitung Center Nanoelectronic Technologies CNT (all genders)
Fraunhofer
💰 Gehalt: keine Angabe
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· Intern
Praktikum: Datenmanagement mit Python
Fraunhofer
💰 Gehalt: keine Angabe
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Maintenance Technician – Backend (Semiconductor Manufacturing)
Bosch
💰 Gehalt: keine Angabe
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Embedded Linux Engineer mit Projektverantwortung (m/w/d)
ibe Ermisch GmbH
CppYocto
💰 Gehalt: keine Angabe
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Studentische Hilfskraft (m/ w/ d) für Programmiertätigkeiten inklusive VR-Entwicklung
Fraunhofer
💰 Gehalt: keine Angabe
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Linux Infrastructure Engineer / Linux System Engineer (m/w/d)
Anvajo
Vmware
💰 Gehalt: keine Angabe
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· Intern
Werkstudent / Werkstudentin Embedded-Software & Evaluierungstools (all genders)
Fraunhofer-Gesellschaft
Cpp
💰 Gehalt: keine Angabe
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Baukoordinator- und Steuerer Glasfaserausbau Specialist Network Deployment (m/w/d)
Vodafone
💰 Gehalt: keine Angabe
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Abschlussarbeit: Innovation vorantreiben - Marktanalyse & Vermarktung von Quantentechnologien
Fraunhofer-Gesellschaft
💰 Gehalt: keine Angabe
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Wissenschaftlicher Mitarbeiter Elektrolyse - Wasserstofftechnologie (all genders)
Fraunhofer-Gesellschaft
💰 Gehalt: keine Angabe
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Studentische Hilfskraft im Bereich Cyber-physische Produktionssysteme
Fraunhofer-Gesellschaft
💰 Gehalt: keine Angabe
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Wissenschaftliche Tätigkeit im Bereich Interconnect Technologies (all genders)
Fraunhofer-Gesellschaft
💰 Gehalt: keine Angabe
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Digital Design Engineer für High End Kommunkations-IP-Cores (all genders)
Fraunhofer-Gesellschaft
VerilogVhdl
💰 Gehalt: keine Angabe
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